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VHDL设计的电子数字钟，参赛作品功能齐全，代码相当精简！极力推荐！！！！！！！！！

本代码是基于压缩感知的光谱成像代码，与杜克大学文章想匹配

Verilog流水线CPU配套源码（v文件），详细代码注释以及流程分析信息请移步至本人博客“Verilog流水线CPU设计（超详细）”已经于2019.12.17更新

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从标定板的制作、打印到拍摄成图片一应俱全，并附有相机标定的代码，以及最终标定的结果

基本的SIRT重建算法，已调试，可以运行。做的比较简单，有兴趣的话可以在这个的基础上加点东西。欢迎交流讨论~

CIC内插滤波器的verilog程序，可以改变内插的倍数。

【实例简介】1.任务申请.doc 2.可行性与计划阶段--可行性研究报告.doc 3.需求分析阶段--需求说明书.doc 4.概要设计阶段--数据库设计说明书.doc 5.详细设计阶段--详细设计说明书.doc 6.实现阶段--模块开发说明.doc 7.单元测试阶段--单元测试报告.doc

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