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本文件是周立功试验开发板的配套资料,容易学会

于 2023-03-21 发布 文件大小:5.37 MB
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本文件是周立功试验开发板的配套资料,容易学会-This document is ZLG test development board supporting information, easy to learn

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    说明:  fpga串口的接收程序基于verilog语言拿走不用谢。(The receiving program of FPGA serial port is based on Verilog language.)
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  • my_lift
    电梯控制,包括楼层按键相应,显示上下状态。(Elevator control, including the floors of the corresponding button to show the whole state.)
    2008-04-24 10:15:52下载
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  • Xilinx-Timing
    Xilinx FPGA 时序约束资料,原厂出品,经典不需要理由(Xilinx FPGA timing constraint information, original, classic no reason)
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  • matlab2DPSK
    蒙特卡洛仿真图 这个程序对2psk信号进行仿真 前提是把信号能量归一化了 (This programme intend to realize the simulation of 2DPSK through MonteCarlo experiment. intends )
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    对视频编解码芯片ADV7181进行合理的配置,使其输出符合ITUR656标准的视频流-Of the ADV7181 video decoder chip for a reasonable configuration, so that the output in line with the standard video streaming ITUR656
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  • 实验12
    说明:  数字逻辑实验课第十二次作业,基于Verilog的Clock时钟(Clock based on Verilog)
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