vhdl经典源代码――键盘接口设计，入门者必须掌握

说明：  实现（7,4）BCH码的编码和译码。已知生成矩阵和校验矩阵，通过c=m*G进行编码，译码时利用伴随式译码。s=c*H‘，求得伴随式，对应的错误图样找到错误位置，对错误位置进行更正，得到译码结果。(Coding and decoding of (7,4) BCH Codes)

说明：  基于CycloneV FPGA与电阻网络的数模转换器代码，能够实现键控更改频率，通过ROM IP核存储波形数据。(Digital to analog converter code based on cyclonev FPGA and resistance network can realize keying change frequency and store waveform data through ROM IP core.)

这是执行高速的代码通用异步收发器代码是用VHDL写的语言.UART是一种在传输端进行并行输入和串行输出，在接收端进行串行输入和并行输出的算法。

设计一个控制十字路口的交通信号灯。 某大学决定在校园学术路文化路交汇处安装交通灯，以控制交通。两套交通信号灯，redA，yellowA，greenA和redC，yellowC，greenC分别安装在学术路上和文化路上。两个传感器TA和TC分别安装在这两条路上。如果有交通，每个传感器都会显示为TRUE，如果街道为空，则表示FALSE。 当控制器复位时，学术路的绿灯亮，文化路上为红灯亮。 每5秒钟，控制器检查流量传感器并决定下一个状态。只要学术大楼出现交通，即TA=1，绿灯亮；当学术大街上无交通， 黄灯亮5秒钟，然后变成红灯，同时文化路上绿灯亮。 在这种状态下，每5秒控制器检查文化路上的交通传感器。只要文化路上有交通就保持绿灯亮。如果没有交通，绿灯会变成黄灯，最后变成红灯。

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UART program for fun(UART)

说明：  用FPGA实现8点fft，整个代码使用verilog编写，主要运用了加法器和乘法器，简单易懂(8-point FFT with FPGA, The whole code is written by Verilog, mainly using adder and multiplier, which is easy to understand)

基于 quartus 2 的 lte 信道估计verilog hdl代码 只有功能仿真 时序仿真自己加sdc文件并且调整testbench的clk才能做出来(Estimated Verilog HDL code based Quartus lte channel only functional simulation timing simulation plus sdc file and adjust the testbench clk to do it)

内有LED译码器，汉明纠错译码器，地址译码器，最高优先译码器，双2－4译码器等VHDL的源代码-decoder, Hamming error correction decoder, address decoder, the highest priority decoder, dual 2-4 decoder such as VHDL source code

这是我准备电子设计大赛时，用VHDL写的一个自动打铃系统，很好的学习资料。-This is when I am going to Electronic Design Contest, use VHDL to write an automatic bell playing system, a very good learning materials.