登录
首页 » Verilog » Content Addressable Memory (CAM)

Content Addressable Memory (CAM)

于 2022-07-19 发布 文件大小:107.16 kB
0 136
下载积分: 2 下载次数: 1

代码说明:

内容访问存储器(CAM)是计算机内存中的一种特殊类型的在某些非常高速的搜索应用中使用。它也被称为相联存贮器,联想存储或关联数组,虽然最后术语更多地被用于编程的数据结构。[1]它比较输入的搜索数据(标签)对存储的数据的表,并返回匹配的数据的地址(或在相联存储器中,匹配数据的情况下)。[2]的若干定制计算机,像固特异STARAN,是用来实现CAM,和被指定的关联的计算机。不像在其中用户提供的存储器地址和RAM返回存储在该地址中的数据字的标准计算机存储器(随机存取存储器或RAM),一个摄像机的设计,使得用户提供一个数据字和所述CAM搜索其整个存储器看是否该数据字被存储在任何地方。如果找到该数据字,所述CAM返回的其中单词被发现(和在一些结构中,它也返回数据字,或其它相关联的数据块)的一个或多个存储地址的列表。因此,一个CAM是在硬件中哪些软件项将被称为anassociative阵列实施例。数据字识别单元,提出了达德利·艾伦·巴克于1955年[3]在一个互操作性协议规定的凸轮和其他网络搜索引擎(网络搜索引擎)的主要接口定义称为后备接口(LA-1和LA-1B)的网络处理论坛,后来与光互联论坛合并发展(OIF)。许多设备已经生产的集成设备技术,Cypress半导体,IBM,博通等人到洛杉矶的接口协议。 2007年12月11日,法语国家组织公布的串行后备(SLA)的接口协议。因为摄像机的设计,以搜寻其整个存储器在单个操作中,这是很比内存在几乎所有的搜索应用程序更快。有成本劣势然而,CAM。不像一个RAM芯片,其具有简单的存储单元,在一个完全并行CAM的每个单独的存储器位必须有其自己相关联的比较电路,以检测所存储的比特和在输入比特之间的匹配。另外,从在所述数据字中的每个单元格匹配的输出必须被组合,以产生一个完整的数据字的匹配信号。该附加电路增加的CAM芯片这增加了制造成本的物理尺寸。额外的电路还增加了功率消耗,因为每一个比较电路是有源在每个时钟周期。因此,CAM仅用于专门的应用中检索速度不能使用成本较低的方法来实现。一个早期的成功实施是一个通用处理器联想IC和系统。[4]为了实现速度,存储器大小和成本之间的不同平衡,一些实现方式通过使用标准的树搜索或散列在硬件设计中,使用硬件花样像复制或流水线,以加快有效性能

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • APB总线slave
    完成APB slave 的单次寄存器读写控制,相同时终域完成,简单操作
    2023-05-06 10:10:04下载
    积分:1
  • COMPLETE-OFDM
    完整的OFDM仿真程序,包括QPSK,16QAM调制,基于MATLAB,各个步骤都有详细的说明。(OFDM simulation program, based on the complete MATLAB, every step is described in detail.)
    2013-05-23 11:31:57下载
    积分:1
  • elpiano
    自己写的FPGA实现电子琴的VHDL程序,曲目是两只老虎,用到一些模块,和片内存储间,呵呵(FPGA realization of his keyboard to write the VHDL program, tracks are two tigers, a number of modules used, and on-chip storage room, huh, huh)
    2020-12-28 01:39:02下载
    积分:1
  • fft
    说明:  用FPGA实现8点fft,整个代码使用verilog编写,主要运用了加法器和乘法器,简单易懂(8-point FFT with FPGA, The whole code is written by Verilog, mainly using adder and multiplier, which is easy to understand)
    2021-03-29 20:59:10下载
    积分:1
  • Uart
    RS422通信程序,Verilog语言,此模块实现422通信功能(RS422 communication program, Verilog language, this module implements 422 communication function.)
    2021-04-07 14:59:02下载
    积分:1
  • gtwizard_254_127_ex_1113_3
    配置GTH ip的例子工程,选用7 series 芯片的GTH 113quad的四个通道,在程序中每个链路利用自己的恢复时钟进行数据解码,所以四个通道可以各自独立运行;成功工作在2.54Gb/s的链路状态,长时间(>24小时)的测试,误码率一直为0.(The GTH ip example project is configured with four channels of the GTH 113quad of the 7 series chip. Each link in the program uses its own recovery clock for data decoding, so the four channels can operate independently; the successful operation is at 2.54Gb/ The link state of s, long time (>24 hours) test, the bit error rate has been 0.)
    2019-06-17 21:33:56下载
    积分:1
  • emif_tt
    实现dsp与fpga的emif的verilog异步实现,可实现异步读写以及相应功能模块控制,文件中包含仿真后的波形图形以及仿真测试程序,运行环境quartus ii11.0,仿真环境mmodelsim se 6.5d(Achieve dsp and fpga verilog asynchronous implementation of the emif, enabling asynchronous reading and writing as well as the corresponding function module control, the document contains graphics, and after the simulation waveform simulation testing procedures, operating environment quartus ii11.0, simulation environment mmodelsim se 6.5d)
    2020-12-04 15:59:23下载
    积分:1
  • xiaomi
    新版 小米抢购器 -源码 已经测试,代码很有用,已经抢了好几个小米3了,希望对大家有用(The new millet to snap up- source Have test, the code is useful, has robbed several millet 3, hope useful for everyone)
    2014-01-08 18:26:40下载
    积分:1
  • PWM
    verilogHDL语言编写,简单的FPGA脉冲程序,初学者必备。(verilogHDL language, a simple FPGA pulse program, beginners must.)
    2012-12-27 11:54:45下载
    积分:1
  • OFDm full code
    veriog code for fodm.It includes transmitter and receiver. Transmitter part has serial in parallel out, decoder, interleaver, IFFT and finally to the transmitter block. Receiver part has the reverse order to transmitter.
    2023-02-08 10:40:03下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载