登录
首页 » VHDL » the program have designed a PCM signal timing modules, including the CLK input,...

the program have designed a PCM signal timing modules, including the CLK input,...

于 2022-02-15 发布 文件大小:7.94 kB
0 131
下载积分: 2 下载次数: 1

代码说明:

该程序设计了一个产生PCM码流时序信号的模块,他包括输入端CLK,SET及输出端Q1,Q2,Q3-the program have designed a PCM signal timing modules, including the CLK input, and output SET Q1, Q2 and Q3

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • Collected their own routines VHDL code, suitable for beginners to learn, I hope...
    自己收集的VHDL例程代码,适合初学者学习用,希望能给大家带来帮助。-Collected their own routines VHDL code, suitable for beginners to learn, I hope we can help.
    2022-07-02 04:49:52下载
    积分:1
  • RAM
    这是个双端口双端口ram的定义,当然读者在此基础上还可以扩充(This is a dual-port dual-port ram definition, of course, on the basis of the readers can also be expanded)
    2009-05-24 11:41:19下载
    积分:1
  • Lpfilter_20190503
    说明:  环路滤波器是通信信号调制解调中最重要的一个部分,环路滤波器设计的好坏将直接影响到接收机的性能指标,二阶锁频辅助三阶锁相环路滤波器可以稳定跟踪具有加加速度的信号源,是现代通信中非常实用的技术,本文中详细编写了单载波信号产生模块、信道噪声模块、数字正交下变频模块、鉴频鉴相模块、环路滤波器模块,并包含了完整的testbench模块,对于初学者非常有用。(Loop filter is the most important part of communication signal modulation and demodulation. The design of loop filter will directly affect the performance index of receiver. The second-order frequency locking assisted third-order phase-locked loop filter can stably track the signal source with acceleration speed, which is a very practical technology in modern communication. In this paper, the single carrier signal generation module and channel noise are written in detail Sound module, digital orthogonal down conversion module, frequency and phase detection module, loop filter module, and contains a complete testbench module, which is very useful for beginners.)
    2020-11-11 01:27:25下载
    积分:1
  • arp_2
    rgmii接口通讯方式,用于FPGA以太网口开发(Rgmii interface communication mode)
    2018-11-09 21:56:27下载
    积分:1
  • altera niosii SOPC helloword learning
    altera niosii SOPC helloword 学习-altera niosii SOPC helloword learning
    2022-10-30 21:55:03下载
    积分:1
  • dac5686
    在FPGA上编写的通过SPI总线配置外部DAC芯片DAC5686的程序,通过板级调试,验证可用。程序通过状态机实现,将需要配置的寄存器值转为SPI总线的数据格式发送出去。 (Configure external DAC chip DAC5686 via SPI bus program on FPGA written by board-level debugging, verification is available. Program through the state machine, you will need to configure the register values 椠渀琀漀 SPI bus data format sent.)
    2014-09-11 11:05:20下载
    积分:1
  • hdb3_codedecode
    说明:  用VERILOG实现的,hdb3编码器和解码器,经过前仿真和后仿真成功(Achieved with the VERILOG, hdb3 encoder and decoder, after a successful pre-simulation and post simulation)
    2021-04-22 15:58:49下载
    积分:1
  • spi转i2s的verilog程序,fpga是总模块,spi和i2s是子模块,shiftreg是转换...
    spi转i2s的verilog程序,fpga是总模块,spi和i2s是子模块,shiftreg是转换-spi transfer i2s the verilog program, fpga is the total module, spi, and i2s is the sub-module, shiftreg is to convert
    2022-02-13 16:18:27下载
    积分:1
  • v3
    说明:  mojo v3 complete eagle schematic
    2018-02-08 22:47:52下载
    积分:1
  • lsb 基于可见和不可见数字水印
    < 跨度 style="font-size:12.0pt;line-height:150%;font-family:""> 通过大量数字交换数据生成新的信息安全需求。用户期望的健壮的解决方案将确保法,还保证多媒体文件的真实性。此项目的图像水印算法 usingLeast 有效位 (LSB) 算法被用于信息/徽标中嵌入图像。设计过程进行 theXilinx ISE 设计套件 12.4 和硬件描述语言使用 isVHDL。模拟设计和波形在 Isim(M.81d) 模拟器中得到验证。一旦完成了设计过程,设计但在 Spartan3 FPGA 板。带水印的图像是在 goodvisual 的质量并具有好的 PSNR 值。同时可见并推行 invisiblewatermarking 计划。建议 schemehas 的有效性已表现出与实验结果的援助。Watermarkingis 更可靠、 更经济比软件编码的硬件实现。在空间域中最常见的简单 watermarkingtechnique 是通过操纵最不重要位 (lsb) 整体像素为单位)。要嵌入的水印放置在碱基图像的 LSB。空间域是不太复杂,没有变换使用,但 isn"trobust 数字式图像中的攻击,信息可以直接插入 imageinformation 的每一点或更繁忙地区的图像可以计算这样以中不那么明显的图像部分的 hidesuch 消息
    2022-03-22 20:46:03下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载