基于OFDM的通信系统系带设计

ad9850函数发生器 MSP430单片机驱动程序 扫频 DDS(AD9850 DDS)

this files in Quartus2 are fulladder

使用Verilog语法编写OFDM系统，可借鉴学习，包括发射和接收两部分，发射部分有时钟，映射，交织，加CP、长短训练符号等模块，接收部分有频偏估计，解交织，解映射，维特比译码等模块

题目来源于学校的课题系统硬件综合设计，代码中有单周期CPU设计，多周期流水线CPU设计，使用的是Verilog语言，多周期的是基于MIPS架构。

时序约束方面的经典文章，适合学习FPGA的初学者(A classic article on timing constraints, suitable for beginners to learn FPGA)

32-bit Wishbone Interface • DMA • Buffer Descriptor • Compliant with SD Host Controller Spec version 2.0 • Support SD 4-bit mode • Interrupt-on-completion of Data and Command transmission • Write/Read FIFO with variable size • Internal implementation of CRC16 for data lines and CRC7 for command line Wishbine 总线使用。完整的SD卡控制器，支持文件系统，高速传输。

System Verilog decodificator. Enters a value(binary), drops hundreds, tens and units in BCD

Design of a GF(64)-LDPC Decoder Based on the EMS Algorithm

说明：  ad9361 matlab驱动代码，运行此代码可在matlab中控制AD9361(AD9361 matlab driver code, running this code can control AD9361 in MATLAB)

I2C从机代码，按照I2C基本协议用verilog语言编写，包含了测试模块，建议用xilinx设计套件，加载代码和测试。