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卷积码性能SIMULINK实现

于 2020-12-09 发布
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代码说明:

利用 SIMULINK 仿真模块对卷积码的编码及 Viterbi 译码的全过程进行了设计,然后将译码模块中的 Traceback depth 分别设置为 20,35,50并在一幅图中画出这三种方式下的误码性能曲线。

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