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FPGA数字信号处理(七)级联型IIR滤波器Verilog设计
使用Vivado完成级联型结构IIR滤波器Verilog HDL设计,含testbench与仿真,仿真结果优秀;具体说明可参考本人博客。CSDN博客搜索:FPGADesigner
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空间杜宾模型SDM的Matlab工具箱
用到空间杜宾模型SDM,由于jplv7包中的原有的SDM模型只能分析截面数据,而做面板数据需要jplv7的panel里面给出的SAR模型再自己改编,难度很高。该工具箱是已经直接可以做面板的SDM代码,当然,也可以做SAR,SER等空间计量模型,非jplv7的原始版本(Elhorst在此基础上的修改),套用这个代码,做空间计量模型(SDM,SAR,SEM),除了可以得到模型系数估计值,还可以计算自变量对因变量的直接效应和间接效应。
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opencv3.2.0在VS2015下的编译库(包含32位和64位)
包含window系统下32位和64位的opecv3.2.0编译库以及头文件,64位编译库对应在x64文件夹下,32位编译库对应在x86文件夹下,本人已在win10+vs2015的x64/x86开发平台上实验成功
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the zynq book.pdf
【实例简介】一本新出的关于zynq的新书,英文版的,里面对xilinx zynq的开发,有详细的探讨与运用。
- 2021-12-07 00:39:39下载
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接口文档标准模板-含Word和excel两种
接口文档标准的模板,包含Word和excel两种模板。满足各种语言接口需要。
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哈夫曼树实现文件压缩和解压(源程序+实验报告).rar
【实例简介】综合实验:
1. 问题描述
利用哈夫曼编码进行通信可以大大提高信道利用率,缩短信息传输时间,降低传输成本。这要求在发送端通过一个编码系统对待传输数据预先编码,在接收端将传来的数据进行译码(复原)。对于双工信道(即可以双向传输信息的信道),每端都需要一个完整的编/译码系统。试为这样的信息收发站编写一个哈夫曼码的编/译码系统。
2. 基本要求
一个完整的系统应具有以下功能:
(1) I:初始化(Initialization)。从终端读入字符集大小n,以及n个字符和n个权值,建立哈夫曼树,并将它存于文件hfmTree中。
(2) E:编码(Encoding)。利用已建好的哈夫曼树(如不在内存,则从文件hfmTree中读入),对文件ToBeTran中的正文进行编码,然后将结果存入文件CodeFile中。
(3) D:译码(Decoding)。利用已建好的哈夫曼树将文件CodeFile中的代码进行译码,结果存入文件Textfile中。
(4) P:印代码文件(Print)。将文件CodeFile以紧凑格式显示在终端上,每行50个代码。同时将此字符形式的编码文件写入文件CodePrin中。
(5) T:印哈夫曼树(Tree printing)。将已在内存中的哈夫曼树以直观的方式(比如树)显示在终端上,同时将此字符形式的哈夫曼树写入文件TreePrint 中。
3. 测试数据
用下表给出的字符集和频度的实际统计数据建立哈夫曼树,并实现以下报文的编码和译码:“THIS PROGRAME IS MY FAVORITE”。
字符 A B C D E F G H I J K L M
频度 186 64 13 22 32 103 21 15 47 57 1 5 32 20
字符 N O P Q R S T U V W X Y Z
频度 57 63 15 1 48 51 80 23 8 18 1 16 1
- 2021-12-01 00:38:17下载
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STM32 stm32g071 关于待机模式和关闭模式的进入和退出(RTC和wakeup pin) HAL库 Standby Mode and Shutdown Mode
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