比较完善的CRC编码VerilogHDL描述

vhdl代码多路开关，小系统使用，非常方便-VHDL code multi-channel switch, a small system, a very convenient

pcf8563的中文技术资料,不知道具体上载到哪儿,因此放入其他类中,希望对大家有所帮助!-pcf8563 Chinese technical data and do not know where specific uploading, Add other category, We want to help!

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8大特色: 1.自动枚举串口，这样避免了有些机器串口多，或者串号号>4的情况。 2.保存文件格式为txt和CSV，可选，方便做数据分析。 3.保存文件在执行文件程序路径下的SaveData文件夹里 4.增加多字节联合显示 5.2字节时，十六进制会加"0x"头，非十六进制时，以十进制显示，末尾自动加一空格，以区分。 6.4字节时，只能以十六进制显示（因十进制以超出范围，也没有必要显示那么大一个数）。 7.增加实时显示数据曲线功能。 8.界面更人性化，方便适用。-8 characteristics: 1. Automatically enumerate the serial, so to avoid some of the machine serial number or serial number No.

介绍如何用单片机配置FPGA，仅供参考，如有疑问请联系我。-how to use microcontroller FPGA configuration, for reference purposes only, if any questions, please contact me.

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工资管理系统源代码.很好...开发了很长时间，做得很好，不信你看看，看看就知道了。。。。。。。。。真的吗？？是真的-salary management system source code. A good development ... for a very long time, does a good job, do not think you see the will know. . . . . . . . . Really? ? Really.

用VHDL实现的电子时钟，24小时格式，可以通过按键调整时间得益于数电知识中的计数器级联构成高进制计数器的启发，我的思路是这样的：1）各不同位的时钟问题。时钟共有6位，分别为秒的高低位、分的高低位、时的高低位。把秒低位的进位当作秒高位的时钟，秒高位的进位当作分低位的时钟，依次类推，可以解决不同位的不同时钟问题。2）各不同位的进制问题。与此同时要解决进制问题，秒分的低位为十进制，秒分的高位为六进制，以及时的高位为三进制（电子时钟为24小时制），这五种情况都易解决，但时的低位就有点复杂了，既有十进制的情形又有四进制的情形。仔细琢磨之后，根据两条IF语句解决了这个问题。那就是若小时高位为”0000”或”0001”时，时的低位为十进制，若小时高位为”0010”，时的低位为四进制。3）校时问题。刚开始时，对了校时没有个思路。但有一次我想看看整体进制等对不对，于是把整体时钟调快了很多，这样，很快就走了“24”小时，然后灵感就来了，就想可以设置这么两个不同频率的整体时钟，一个可能控制分，一个可以控制小时，然后为了可以精确到秒，又设置了一个可以让整个时钟系统暂停的按键，这样整个时钟的实现就完成了，最后又在时分和分秒中间加入了一个小横杠”-”。

二维FDTD模拟 pml吸收边界程序，功能强大，书写详尽-Pml absorbing boundary two-dimensional FDTD simulation program, powerful, writing a detailed

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