IIC驱动 verilog

axi_lite_user官方样例，精简功能，适用于zynq系列axi总线(Axi_lite_user official sample, streamline function, apply to zynq series Axi bus)

当设计的记忆与大的部分，其中包括电容对位线。两位线用于执行读和写操作，由于放电电容在写操作中的操作。7T sram 存储单元减少了活性因子的排位线对执行写操作。7T sram 存储单元减少了活性因子的排位线对执行写操作。

基于FPGA的Verilog语言的智能小车，已经经过测试。(FPGA-based smart car Verilog language, and has been tested.)

基于BCD码的十进制ALU设计，可实现加减乘除的功能(BCD to decimal ALU based design can achieve the arithmetic function)

这是一个基于Quartus2 开发环境的4输入加法器( 4adder basic on Quartus2)

说明：  RISC-V手册 最新版 一本开源指令集的指南 我们打算将这本薄薄的书作为 RISC-V的介绍和参考 资料 ，供有兴趣编写 RISC-V代码的 学生和嵌入式系统程序员使用 。 本书假设读者事先已经 了解 过至少一个指令集。如果没 有，您可能希望浏览基于 RISC-V的相关入门架构手册： Computer Organization and Design RISC-V Edition: The Hardware Software Interface。(risc v reader chinese)

LTE上行链路使用的DFT-S-OFDM系统的仿真，其中包括QPSK星座映射、串并转换、N点DFT、子载波映射等。(LTE uplink using the DFT-S-OFDM system simulation, including QPSK constellation mapping, string and conversion, N-point DFT, subcarrier mapping, etc..)

说明：  Protel中VHDL设计参考,pdf,不错的一本学习VHDL的书(Protel design in VHDL)

RTL码由控制、alu、寄存器、keych模块等组成。。。

使用Quartus II 9.1完成俄罗斯方块游戏，只要使用有VGA和键盘接口的FPGA开发板就行实现。操作简单，使用的是VHDL和Verilog语言(Use the Quartus II 9.1 to complete the tetris game, as long as you use a VGA and keyboard interface implementation of FPGA development board. The operation is simple, the use of VHDL and the Verilog language)