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Sdram 控制器

于 2022-07-04 发布 文件大小:14.83 kB
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代码说明:

在 verilog 代码 sdram 控制器. 在 first.rar-- matlab 代码是在 first.rar 为接收器分布给出了在 MATLAB 文件 clockTreeAssignment.m 中找到零偏差时钟直线树。 发现从根源到汇的延迟 (时钟延迟)。使用埃尔莫尔延迟-model(i.e no need to do SPICE simulation) 请点击左侧文件开始预览 !预览只提供20%的代码片段,完整代码需下载后查看 加载中 侵权举报

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  • ahb_sramc
    基于AHB总线的sram控制器,带有memory bist(SRAM controller based on AHB bus)
    2018-05-19 20:47:28下载
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    在fpga上实时实现图像的直方图均衡化,有效利用fpga芯片的片内资源,不需要添加片外的存储芯片。本代码是基于ycbcr处理的,其实只对亮度分量进行直方图均衡化,之后同步cb,cr颜色分量,避免偏色问题!代码接口为y,cb,cr,以及行场信号,hs,vs,de.最终的处理效果可以达到在pc机上的效果,但是比pc块很多,几乎可以实时完成处理
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    2020-06-21 21:40:01下载
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    2020-12-01 10:39:28下载
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    2020-06-21 12:00:02下载
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  • 7941952NCO_sin
    NCO 代码设计 使用VHDL语言 (nco)
    2009-05-23 16:39:37下载
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  • dds_rom
    基于查找表的DDS的Verilog实现,分为相位累加器模块、ROM模块和顶层DDS模块(Verilog implementation of DDS based on lookup table)
    2021-03-10 11:19:26下载
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  • SAR-ADC
    Complete Successive approximation Analog to digital converter along with the source code
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