Verilog写的88E1111 GMII接口驱动代码

详细讲解Slave FIFO模式下的初始化设置和相对应寄存器说明(Explain in detail the initial setup Slave FIFO mode and the corresponding register description)

说明：  实现AHB转SRAM接口实现，支持猝发，零等待延迟(Implementation of AHB to SRAM Interface)

一共7篇文章，介绍了使用fpga产生任意分布白噪声的方法，值得借鉴(A total of seven articles, describes using fpga to generate arbitrary distribution of white noise, it is worth learning)

一个自定义的内存，存储了一个链表，通过数据通路访问内存，读取数据，计算链表累加和，数据通路的控制器由一个有限状态机组成，实现了多状态下控制信号的产生，计算的结果回写到内存制定单元。整个过程介绍了有限状态机的设计以及数据通路控制的基本原理

EMIF接口调试代码，使用的是Verilog语言，FPGA与DSP通信，测试成功(EMIF interface debugging code that USES the Verilog language, FPGA and DSP communication, testing success)

交通灯控制芯片，该芯片具有如下功能： 1）芯片采用中芯国际 0.18工艺设计，外部采用5V电源供电，内部添加LDO模块使内部数字电路采用1.8 v 的VDD、模拟电路采用3.3 v VCC。 请点击左侧文件开始预览 ！预览只提供20%的代码片段，完整代码需下载后查看 加载中 侵权举报

今天的系统芯片 （SoC） 验证发生在低的抽象级别，通常在寄存器传输级(RTL)。随着 SoC 设计的复杂性，它是越来越重要了，搬到较高抽象级别的验证。硬件/软件协同仿真是这一步方向，而是由于错误的处理器不足够型号和低速的硬件仿真速度。系统级监测，通常用于基于事件的软件调试，提供有关任务调度事件，任务间通信信息和， 同步信号量/资源、 I/O 中断等我们目前 MAMon1可以监测系统两个监视逻辑级和系统级的 单/多处理器片上系统。小硬件探测器单元集成在 SoC 设计中，并通过一个基于主机的监测工具环境的并行端口链接连接。探头装置在运行时，在目标系统中收集的所有事件和时间戳他们的分辨率为 1 s。事件然后存储在主机上的数据库进行进一步的处理。本文将叙述 MAMon 以及它适用于软件和硬件监控。本文还描

预失真算法中，包络解波部分的verilog代码，有部分错误(envelope calculation of DPD algorithm ，verilong HDL language)

SDRAM即同步动态随机存储器，同步是指memory工作需要同步时钟，内部命令的发送与数据的传输都以它为基准；动态是指存储阵列需要不断地刷新来保证数据不丢失；随机是指数据不是线性依次存储，而是自由指定地址进行数据读写

说明：  OFDM的简易verilog仿真程序，环境是quartus，版本需要7.2以上(OFDM Modulation and Demodulation using Verilog in Quartus)