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TrackMe
人的移动的跟踪,VERILOG实现,能跟踪人的画面移动(Tracking the movement of people, VERILOG realize that can track the person)
- 2021-04-29 15:48:43下载
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AD7266的Verilog驱动程序,已仿真通过,可直接在EDK下使用.
AD7266的Verilog驱动程序,已仿真通过,可直接在EDK下使用.
- 2022-01-31 15:55:05下载
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test
利用ANSYS有限元仿真软件对复合材料进行异常检测仿真实验,程序为一损伤样板模型(ANSYS finite element simulation software for composites simulation anomaly detection, the program is a damage model model)
- 2016-04-04 11:15:04下载
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电梯控制 记忆,上升下降停站 超载报警故障.....。
电梯控制 记忆,上升下降停站 超载报警故障.....。-Verilog EDA dianti
- 2023-06-16 03:50:04下载
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signal_capture
matlab 程序 伪随机码的捕获,我传的都是这方面的资料!(failed to translate)
- 2013-05-03 12:02:48下载
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hdl
网上流传的用来实现FPGA驱动VGA,从而实现一个pingpong小游戏的源码,实测可用。(a program embedded in a FPGA in order to drive the VGA and realize a little game named pingpong.
tested.)
- 2009-03-31 22:36:37下载
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beep_interface
这些代码为 对于基本的FPGA使用模块beep进行了例化 在工程 系统级建模时只需要直接调用就好了(The code for the basic FPGA using the module beep instantiated only need to be called directly in the engineering system-level modeling like)
- 2013-05-05 21:07:18下载
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LED7s
七段LED数码管显示译码器设计,将输入的16位二进制数据分别输出到4个数码管上(Seven-segment LED display decoder design, the input of 16 binary data are output to the four digital tube)
- 2021-04-23 23:28:47下载
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音频最新项目
音频编解码器 (ADPCM 1 位)代码是准备 Altera 旋风 II DE1 起动器板和它进行了测试,您可以修改代码,并使用它们在任何项目中。岩心描述:采样频率: 44100hz频道: 立体声比特率: 1 位每 Sample(So it is: 44.1 * 2 = 88.2kbps)压缩比: 16: 1VHDL 代码包括:1 位 ADPCM Decoder(x2)、 I2S Driver(x1)、 I2C Driver(x1)、 快闪记忆体 Driver(x1),键盘 Driver(x1)、 LED Bar(x1)、 容量和配置 Engine(x1)。Codec(Encoder/Decoder) 是可以使用它来编码 PCM 原始的波形文件,然后刻录的 Win32 应用程序中可用 *。DJ 文件到闪光灯,确保 flash 不是已经清楚 (你可以使用 EDK 控制面板来清除和程序 flash) 在 FPGA 上运行的代码。那里是没有专利或版权,这免费的每个人在任何项目中使用。
- 2023-08-28 07:45:05下载
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table-for-sin-functionof-
DDS中的正余弦生成,初始相位相差90度,可自行改变输出频率(Cosine generation of DDS, the initial phase difference of 90 degrees, the output frequency can be changed on their own)
- 2013-12-17 22:09:56下载
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