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verilog 多周期CPU设计

于 2022-02-28 发布文件大小:25.28 kB

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计算机组成与设计课程设计用verilog与FPGA设计多周期CPU 通过modelsim仿真与ISE综合

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SineGen
Basic VHDL code to create a sine wave generator for an FPGA board.

2014-01-24 01:04:15下载

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sph-original-codes
SPH的原始代码，希望可以帮到大家啊关于模拟poiseuille的(simulate poiseuille fuild)

2020-10-22 10:27:23下载

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Poiseuille_BB_solution
LBM用于Poiseuille流初学者程序，直接反弹格式(LBM Poiseuille)

2021-02-24 15:49:39下载

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Verilog乒乓操作实现的代码
利用verilog实现乒乓双缓存代码，比异步FIFO更可靠地缓存。

2022-02-26 23:38:45下载

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QAM_FPGA
QAM调制，基于FPGA的实现，包含有乘法器模块、升降余弦滤波器模块、QAM序列生成模块(QAM modulator,the implementation based on FPGA,include MUL、FIRCOS and QAM generate)

2021-03-03 01:49:33下载

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红外接收器的verilog模块
本模块适合所有红外接收端，使用时请注意修改地址码，要接收的就是识别用户码，代码里有标注，谢谢大家的支持！

2022-01-26 03:34:43下载

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sin
基于单片机的DDS数字信号发生器设计，可以产生正弦波。三角波等(Design of DDS digital signal generator based on MCU, can produce sine wave. Triangular wave)

2013-04-03 18:24:00下载

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03_hbf_test_128m22
说明：半带滤波器，工作在采样率122.88Msps上(Half-band filter, working at the sampling rate of 122.88 Msps)

2020-12-23 10:59:07下载

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2003101190493221
还好用，大家一起来看下，不错的图书管理软件啊，呵呵(Fortunately with, everyone look, the good library management software, ah, huh, huh)

2010-09-14 13:08:40下载

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FIR_poroje
this project is about FIR FIlter By VHdl codes in the ISE.

2013-09-29 19:25:16下载

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