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DDR2芯片控制模块verilog

于 2022-02-13 发布文件大小:1.19 MB

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代码说明：

ddr2存储器控制模块，大家可以拿去借鉴，其中对DDR2内部时钟刷新本人花了很久的时间。内部时钟频率请各位已经自己芯片情况而定。本人也是新手，代码中有不少地方也许欠妥，大家共同学习，谢谢。

下载说明：请别用迅雷下载，失败请重下，重下不扣分！

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flash
本程序是fpga控制flash的读写程序，包括了程序和仿真时的测试文件(fpga flash)

2013-07-21 14:47:36下载

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FPGA实现UART接收和发送
在fpga中实现实现了UART的功能，经过实际在ep4cE6 fpga上下载测试，发现可以准确的接收个发送串口数据，和板子上的单片机uart通信正常。要使用的小伙伴，可以直接拷贝使用。

2022-01-31 07:33:26下载

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divider
verilog HDL编写的浮点除法器，编译通过，可综合。压缩包包含三个文件。(verilog HDL write floating-point divider, compile, can be integrated. Archive contains three files.)

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code
PLL中的TDC和DCO代码,是TI公司团队的，相当经典的代码，非常不错(the code of TDC and DCO)

2020-12-10 10:29:19下载

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verilog ram读写程序
使用verilog编程对ram进行读写，用8位地址控制8位宽的数据进行存储。

2022-04-01 03:45:46下载

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ISE_uart
自己在ISE下用VHDL写的UART，简单，易懂(in ISE using VHDL was the UART, simple, understandable)

2021-03-08 21:59:28下载

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UART_real_time_clock
This is an UART real time clock

2009-06-07 01:21:41下载

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DCT
用verilog语言实现DCT编解码附有DCT的说明(Using Verilog language realize DCT codec with a description of DCT)

2020-11-14 15:19:41下载

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vhdl-golden-reference-guide
vhdl golden reference guide

2012-12-31 03:56:13下载

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test_vhdl
vhdl测试程序，用于初雪者熟悉hdl的具体语法应用。比较简单了。(VHDL test procedure for the First Snow hdl who are familiar with the application of specific syntax. A relatively simple.)

2009-01-09 18:25:34下载

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