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bcd_to_dec
VHDL code for converting BCD to Decimal
- 2018-02-13 09:45:16下载
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mealy fsm 和moore fsm
mealy fsm å’Œmoore fsm-mealy Fsm and moore Fsm
- 2023-04-04 18:30:04下载
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CY7C68013A_board_test
该资料基于FPGA实现USB2.0的高速传输,即CY7C68013A芯片的数据传输,包括FPGA与上位机之间数据的相互传输,CY7C68013A的传输速率最高可达480M/S。(The FPGA-based high-speed data transmission USB2.0, that CY7C68013A chip data transmission, including the mutual transmission of data between the FPGA and the host machine CY7C68013A transfer rate up to 480M/S.)
- 2020-08-24 21:48:15下载
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spwm
关于SPWM调制设计VHDL代码
关于SPWM调制设计VHDL代码(SPWM modulation on the design of VHDL code design on the VHDL code modulation SPWM)
- 2021-03-16 09:19:22下载
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小波变换VHDL
JPEG2000中的小波变换部分的VHDL源代码。
JPEG2000的核心算法是建立在离散小波变换基础之上的。由于离散小波变换的优良特性使得它成为JPEG2000的核心编码技术:一方面,它能很好地消除图像数据中的统计冗余;另一方面,小波变换的多分辨率变换特性,很好地利用了人眼视觉特性,而且小波变换后的图像数据,能够保持原图像在各种分辨率下的精细结构,为进一步去除图像中其它形式的冗余信息提供了便利。
首先对输入数据按行作小波变换,经水平滤波后并下采样分解出沿水平方向上的低频和高频分量。其次对行处理后的数据按列进行垂直滤波和下采样,这样一幅图像就被分解成四个尺寸分别为原图的四分之一的子图,它们对应十四个子频带:分别为水平方向低频和垂直方向低频(LL子带)、水平方向低频和垂直方向高频(LH子带)、水平方向高频和垂直方向低频(HL子带)、水平方向高频和垂直方向高频(HH子带),HL,LH,HH称为细节子图,LL称为低分辨率子图。再对LL再作运算,可得到二级小波变换如图3所示。可以看出在高频子带中的能量非常低,大部分能量都集中在LL子带中,这对于图像压缩很有利。
- 2023-04-21 08:15:03下载
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BCH码的二进制FEC码的译码
应用背景BCH码是一种流行的用于存储和传输系统中使用的纠错码。它增加了一些冗余检查数据到原始数据帧,冗余数据长度取决于校正能力,和所有计算进行在伽罗华域,适用于FPGA。关键技术编码:线性反馈移位寄存器解码器:1。证算有2×T-1型要求。首先得到奇数阶的。计算时间不一多项式分裂。都有生成多项式和多项式T T特征多项式。接收到的数据分别由T多项式分,上对应于2×T-1电力原始元素综合征,是从1到T。其次,即使顺序综合征的计算奇数的2。误差位置多项式计算误码位置多项式是由无逆的BM算法计算。计算迭代最多2×t-1时刻。定义为综合征的顺序是2×T-1。定义V是错误位置多项式的阶为2×T-1。有一些变量在计算。3.error位置搜索中国搜索的方法来找到错误的位置。每一个元素放在伽罗瓦域为该错误位置多项式,如果其结果等于零,则该元素对应于误差位置。搜索可以进行并行以缩短运行时间。
- 2023-02-10 12:45:03下载
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rd1020
Synchronous DRAM (SDRAM) has become a mainstream memory of choice in embedded system memory design
due to its speed, burst access and pipeline features. For high-end applications using processors such as Motorola
MPC 8260 or Intel StrongArm, the interface to the SDRAM is supported by the processor’s built-in peripheral module.
- 2010-07-30 16:51:31下载
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juanji
FPGA的卷积编码小程序,VHDL描述,参数为2,1,7.(2,1,7 cov with VHDL.)
- 2010-09-24 20:28:22下载
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100vhdlsimple
说明: 100个vhdl例子,对初学者很有用,可以用MAX+PLUS 2来编译仿真的(100 vhdl example, useful for beginners, you can use the MAX+ PLUS 2 to compile the simulation)
- 2010-05-02 10:01:58下载
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FPGA7人表决器
–ABCDE五路输入表示五人的选择,同意为1,不同意为0,以开关形式实现
–有半数以上同意绿灯亮,否则红灯亮。即分别对应输出Y、R为1或0
–参考仿真结果图:10ns|20ns|30ns|40ns|50ns
- 2022-10-01 22:45:03下载
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