-
verilog 编写基于SRAM(CY7C1041)的代码
verilog 编写基于SRAM(CY7C1041)的代码-Verilog prepared based on the SRAM (CY7C1041) code
- 2022-07-05 00:16:39下载
- 积分:1
-
basic_cpu_mano_ise_vhdl
morris mano basic vhdl code in ise
- 2014-01-13 05:52:01下载
- 积分:1
-
4
说明: 通过监测工作状态实现带有IIC通讯功能的数据发送接收(to implement the sending and receiving data function of iic
communication )
- 2013-09-29 09:51:55下载
- 积分:1
-
CLA
超前进位加法器得VHDL实现小点资料代码(CLA was a small point of information VHDL code)
- 2007-11-14 20:26:59下载
- 积分:1
-
Min-Max
calculate min max of series of nb
- 2009-08-08 16:26:52下载
- 积分:1
-
liyuanlnx_dynamic_led
FPGA数码管显示秒表实验
三种方法实现:
方法一: 对秒计数,得到(秒显示)0~9,
对(秒显示)计数,得到(分秒显示)0~5,
对(分秒显示)计数,得到(分钟显示)0~5,
注意进位时机
方法二: 对秒计数,得到(秒显示)0~9
对秒计数,得到(分秒显示)0~5
对秒计数,得到(分钟显示)0~5
方法三:
只对秒计数,分别取模
%60得到分钟显示 ************************
余数%10得到分秒显示 (据说)取模运算占资源!!!!(也能接受?好像...)
再剩下的余数为秒显示 ************************(Experiment of Digital Tube Display Stopwatch Based on FPGA
Three ways to achieve)
- 2020-06-22 04:40:02下载
- 积分:1
-
vhdl实现vga接口设计,非常实用的一段代码,学习用
vhdl实现vga接口设计,非常实用的一段代码,学习用-vhdl achieve vga interface design
- 2023-05-25 04:40:03下载
- 积分:1
-
LMS filter
这是一个用结构化语言编写的25抽头LMS算法建模.VHDL加法器/减法器、乘法器、延迟元件的代码分别编写并用LMS代码实例化。
- 2022-02-10 10:42:31下载
- 积分:1
-
rfid_re
VHDL实现 DDS。大家共享吧,一起学习,一起进步(VHDL realize DDS. U.S. to share it with learning, with progress)
- 2008-05-16 15:12:13下载
- 积分:1
-
cordic_verilog
cordic算法的verilog 语言实现,注释详细,资料齐全,实现了cordic算法的各个功能,可以计算正余弦(cordic algorithm verilog language, detailed notes, and complete information)
- 2020-06-29 16:20:02下载
- 积分:1