新的窗口监控并行BIST

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一个简易数字钟程序，可以实现24小时精确计时、整点报时、时钟矫正、时钟复位等功能

atm工作程序功能

维特比译码器，调用IP核，软判决输入，开发平台Xilinx Spartan-6系列FPGA(viterbi decoder, using IP core resource, soft decision input,develop platform is Xilinx Spartan-6 series FPGA)

the basic system of nexys3(soft core)

基于FPGA的RS编码器设计，verilog hdl语言。(RS encoder FPGA-based design, verilog hdl language.)

DAC VHDL code using SPI method

基于FPGA的数字低通滤波器 。。。。。(FPGA-based digital low-pass filter。。。。。)

说明：  LDPC码的BP译码verliong程序(BP decoding veriong program of LDPC code)

基于System Generator的图像处理工程,多媒体处理FPGA实现的源码,图像边缘提取(System Generator based image processing engineering, multimedia processing FPGA implementation source code, image edge extraction)