FSME有限状态机生成器

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基于Quartus II的FPGA/CPLD数字系统设计实例中图法分类号: TP332.1/684 周润景, 图雅, 张丽敏编著电子工业出版社第1章 Altera Quartus II开发流程1.1　Quartus II软件综述1.2　设计输入1.3　约束输入1.4　综合1.5　布局布线1.6　仿真1.7　编程与配置第2章　Altera Quartus II的使用2.1　原理图和图表模块编辑2.2　文本编辑2.3　混合编辑（自底向上）2.4　混合编辑（自顶向下）第3章　门电路设计范例3.1　与非门电路3.2　或非门电路3.3　异或门电路3.4　

用VHDL语言编写的一位全加器，并实现四位全加器，串行连接

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主要用来进行NOMA中的资源分配，包括了功率分配算法，干扰删除技术。

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HMM隐马尔科夫代码及其说明，很详细，初学者必备，可用来解决一系列问题

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