登录
首页 » Others » FPGA 256点FFT

FPGA 256点FFT

于 2020-11-28 发布
0 388
下载积分: 1 下载次数: 1

代码说明:

verilog实现FFT,自己添加IP核模块。

下载说明:请别用迅雷下载,失败请重下,重下不扣分!

发表评论

0 个回复

  • 多进制纠错码LDPC译码matlab算法仿真序,有注释说明
    多进制纠错码LDPC编译码matlab算法仿真程序,有注释说明
    2020-11-27下载
    积分:1
  • matlab小波信号去噪(可用于预测数据预处理)
    matlab 下实现信号去噪的函数,输入变量为带有噪音的数据序列,输出变量为去噪后的数据.诸位可以用如下代码进行测试,本人测试得到的效果良好x = -4*pi:0.1:4*pi;y = sin(x)*100;y_t = y+rand(1,252)*80;%加噪数据
    2020-12-01下载
    积分:1
  • 用stm32硬件I2C和模拟I2C读写EEPROM
    通过stm32自带的I2C总线进行读写EEPROM,以及通过模拟I2C时序读写EEPROM。程序经测试能正确实现数据读写。
    2021-05-07下载
    积分:1
  • 概率论与数理统计浙江大学第五版电子教案
    概率论与数理统计浙江大学第五版电子教案,和教材完全同步,考研可用!
    2020-11-28下载
    积分:1
  • MPU-6050 六轴传感器数据手册(中文)
    MPU-6050 六轴传感器数据手册(中文)T。pvewTop View88昌翼24123122212019CLKIN18 GNDCLKIN 118 GNDNc 217|NcNC 2Nc6NCNc 316NCMPU-6000MPU-6050Nc16 NCNc514NCAUX DA613VDDAUX_DA613VDDmoQB5B召azQFN PackageQFN Package24-pin, 4mm x 4mm xo9mm24-pin, 4mm x 4mm x 0.9mm+2+7.2典型应用GNDCr 10n2巴2222l2巴2凹2CLKINMPU600回而MPU-6050 sAX CLAUX CLGNDClVLOGIC△NDGNDTypical Operating Circuits73所用电容规格器件标签规格数量校准滤波电容(Pm10)C1陶瓷,Ⅹ7R,0.1uF±10%,2VVDD旁路电容(Pin13)C2陶瓷,Ⅹ7R,0.1uF±10%,4∨电荷泵电容(Pin20)C3陶瓷,Ⅹ7R,10UF±10%,50VLOGC旁路电容(Pin8)C4陶瓷,X7R,10uF±10%,4V7.4上电过程建议Power-Up Sequencing1. TVDDR is VDD rise time: Time for vdd to risefrom 10% to 90% of its final valueVDDR2. TVDDR is $100msec3. tvr is VLOGIC rise time: Time forVLOGIC to rise from 10% to 90% of its finalVDDvaltlVR4. TVGR is S3msec90%5. TvG-VDD is the delay from the start of VDDramp to the start of VLOGIC riseVLOGIC10%6. TVLGVDD is 20: VLOGIC amplitude mustalways be sVDD amplitude7. VDD and VLOGIC must be monotonicramps1.VLOG|C振幅必须sVDD振幅2.VDD上升时间(TvDR)为实际值的10%到90%之间3.VDD上升时间(TvDR)≤100ms4.ⅥLOGC上升时间( TVLGR)为实际值的10%到90%之间5. VLOGIO上爪时间(TvcR)≤3ms6. TVG-VDD为从VDD上升沿到LOG|C上升沿的时间7.VDD和ⅥLOGC必须是单调边沿7.5系统结构图CLKINCLKOUTacknowledgSCL FROMMASTER8clock pulse forSTARTacknowledgementconditionAcknowledge on the ic bus通信开始标志(S)发出后,主设备会传送一个7位的Save地址,并且后面跟着一个第8位,称为Read/ Write位。R^W位表小主改备是在接受从改备的数据还是在向其写数据。然后,主设备释放SDA线,等待从设各的应答信号(ACK)。每个字节的传输都要跟随有一个应答位。应答产生时,从设备将SDA线拉低并且在SCL为晑电平时保持低。数据传输总是以停止标志(P)结束,然后释放通信线路。然而,主设备也可以产生重复的开始信号去操作另一台从设备,而不发出结束标志。综上可知,所有的SDA信号变化都要在SCL时钟为低电平时进行,除了廾始和结束标志。SDA91-7891-7START ADDRESS RN ACKDATAACKDATAACK STOPconditionComplete IC Data Transfer如果要写MPU-60X0寄存器,主设备除了发出开始标志(S)和地址位,还要加一个R∧W位,0为写,1为读。在第9个时钟周期(高电平时),MPU-60X0产生应答信号。然后主设备开始传送奇行器地址(RA),接到应答后,开始传送寄存器数据,然后仍然要有应答信号,依次类推。单字节写入时序Master S AD+WRADATASlaveACKACKACK连续写入时序
    2020-12-05下载
    积分:1
  • AD9361 和Zynq及其参考设计说明.docx
    AD9361 和Zynq及其参考设计说明.docx
    2020-12-03下载
    积分:1
  • 电影票在线售票系统
    完整的一个电影票在线售票系统,适合大家学习
    2020-11-28下载
    积分:1
  • fpga峰值采样verilog
    fpga开发,峰值采样计数,verilog代码
    2020-12-04下载
    积分:1
  • 汽车CAN-BUS通讯协议
    《商用车控制系统局域网络(CAN 总线)通信协议》根 据 国 家 质 量 监 督 检 验 检疫总局国家标准制修订计划20030943-T-5 号进行编制。CAN 总线是一种串行数据通信协议,最早由德国BOSCH 公司推出 ,用于汽车内部测量与执行部件之间的数据通信。CAN 推出之后,世界上各大半导体生产厂商迅速推出各种集成有CAN 协议的产品,由于得到众多产品的支持,使得CAN 在短期内得到广泛应用。
    2020-12-11下载
    积分:1
  • 彩色图像分割MATLAB
    基于HSV彩色空间的图像分割,包含测试图片,MATLAB源程序,可以参考一下
    2020-12-04下载
    积分:1
  • 696516资源总数
  • 106914会员总数
  • 0今日下载